泉州IP射出產(chǎn)品工藝

大家好！今天讓創(chuàng)意嶺的小編來大家介紹下關(guān)于泉州IP射出產(chǎn)品工藝的問題，以下是小編對(duì)此問題的歸納整理，讓我們一起來看看吧。

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本文目錄:

• 1、IP核是什么

• 2、福建 泉州 石獅 這個(gè)IP怎么設(shè)計(jì)

• 3、泉州富發(fā)工藝廠地址在哪里

• 4、“ip射出底”中的ip是什么意思？是指一種化學(xué)材料，還是指什么？

一、IP核是什么

IP核（Intellectual Property core）是一段具有特定電路功能的硬件描述語言程序，該程序與集成電路工藝無關(guān)，可以移植到不同的半導(dǎo)體工藝中去生產(chǎn)集成電路芯片。

概述編輯

利用IP核設(shè)計(jì)電子系統(tǒng)，引用方便，修改基本元件的功能容易。具有復(fù)雜功能和商業(yè)價(jià)值的IP核一般具有知識(shí)產(chǎn)權(quán)，盡管IP核的市場(chǎng)活動(dòng)還不規(guī)范，但是仍有許多集成電路設(shè)計(jì)公司從事IP核的設(shè)計(jì)、開發(fā)和營(yíng)銷工作。IP核有兩種，與工藝無關(guān)的VHDL程序稱為軟核；具有特定電路功能的集成電路版圖稱為硬核。硬核一般不允許更改，利用硬核進(jìn)行集成電路設(shè)計(jì)難度大，但是容易成功流片。

2基本分類編輯

IP內(nèi)核的三種類型

IP內(nèi)核可以在不同的硬件描述級(jí)實(shí)現(xiàn)，由此產(chǎn)生了三類IP內(nèi)核：軟核、固核和硬核。這種分類主要依據(jù)產(chǎn)品交付的方式，而這三種IP內(nèi)核實(shí)現(xiàn)方法也各具特色。

軟核功能

軟核是用VHDL等硬件描述語言描述的功能塊，但是并不涉及用什么具體電路元件實(shí)現(xiàn)這些功能。軟IP通常是以硬件描述語言HDL源文件的形式出現(xiàn)，應(yīng)用開發(fā)過程與普通的HDL設(shè)計(jì)也十分相似，只是所需的開發(fā)硬軟件環(huán)境比較昂貴。軟IP的設(shè)計(jì)周期短，設(shè)計(jì)投入少。由于不涉及物理實(shí)現(xiàn)，為后續(xù)設(shè)計(jì)留有很大的發(fā)揮空間，增大了IP的靈活性和適應(yīng)性。其主要缺點(diǎn)是在一定程度上使后續(xù)工序無法適應(yīng)整體設(shè)計(jì)，從而需要一定程度的軟IP修正，在性能上也不可能獲得全面的優(yōu)化。由于軟核是以源代碼的形式提供，盡管源代碼可以采用加密方法，但其知識(shí)產(chǎn)權(quán)保護(hù)問題不容忽視。

硬核功能

硬核提供設(shè)計(jì)階段最終階段產(chǎn)品：掩模。以經(jīng)過完全的布局布線的網(wǎng)表形式提供，這種硬核既具有可預(yù)見性，同時(shí)還可以針對(duì)特定工藝或購買商進(jìn)行功耗和尺寸上的優(yōu)化。盡管硬核由于缺乏靈活性而可移植性差，但由于無須提供寄存器轉(zhuǎn)移級(jí)(RTL)文件，因而更易于實(shí)現(xiàn)IP保護(hù)。

固核功能

固核則是軟核和硬核的折衷。大多數(shù)應(yīng)用于FPGA的IP內(nèi)核均為軟核，軟核有助于用戶調(diào)節(jié)參數(shù)并增強(qiáng)可復(fù)用性。軟核通常以加密形式提供，這樣實(shí)際的 RTL對(duì)用戶是不可見的，但布局和布線靈活。在這些加密的軟核中，如果對(duì)內(nèi)核進(jìn)行了參數(shù)化，那么用戶就可通過頭文件或圖形用戶接口(GUI)方便地對(duì)參數(shù)進(jìn)行操作。對(duì)于那些對(duì)時(shí)序要求嚴(yán)格的內(nèi)核(如PCI接口內(nèi)核)，可預(yù)布線特定信號(hào)或分配特定的布線資源，以滿足時(shí)序要求。這些內(nèi)核可歸類為固核，由于內(nèi)核是預(yù)先設(shè)計(jì)的代碼模塊，因此這有可能影響包含該內(nèi)核的整體設(shè)計(jì)。由于內(nèi)核的建立(setup)、保持時(shí)間和握手信號(hào)都可能是固定的，因此其它電路的設(shè)計(jì)時(shí)都必須考慮與該內(nèi)核進(jìn)行正確地接口。如果內(nèi)核具有固定布局或部分固定的布局，那么這還將影響其它電路的布局。

介紹

IP（知識(shí)產(chǎn)權(quán)）核將一些在數(shù)字電路中常用，但比較復(fù)雜的功能塊，如FIR濾波器、SDRAM控制器、PCI接口等設(shè)計(jì)成可修改參數(shù)的模塊。IP核的重用是設(shè)計(jì)人員贏得迅速上市時(shí)間的主要策略。隨著CPLD/FPGA的規(guī)模越來越大，設(shè)計(jì)越來越復(fù)雜（IC的復(fù)雜度以每年55%的速率遞增，而設(shè)計(jì)能力每年僅提高21%），設(shè)計(jì)者的主要任務(wù)是在規(guī)定的時(shí)間周期內(nèi)完成復(fù)雜的設(shè)計(jì)。調(diào)用IP核能避免重復(fù)勞動(dòng)，大大減輕工程師的負(fù)擔(dān)，因此使用IP核是一個(gè)發(fā)展趨勢(shì)。

分類

IP核包括硬IP與軟IP。可配置IP是參數(shù)化后的可重定目標(biāo)IP，其優(yōu)點(diǎn)是可以對(duì)功能加以裁剪，以符合特定的應(yīng)用。這些參數(shù)包括總線寬度、存儲(chǔ)器容量、使能或禁止功能塊。

軟IP是以綜合形式交付的，因而必須在目標(biāo)工藝中實(shí)現(xiàn)，并由系統(tǒng)設(shè)計(jì)者驗(yàn)證。其優(yōu)點(diǎn)是源代碼靈活，可重定目標(biāo)于多種制作工藝，在新功能級(jí)中重新配置。

不過大多數(shù)庫是收費(fèi)的，但也可以從網(wǎng)上下載一些免費(fèi)的IP核。

3技術(shù)應(yīng)用編輯

數(shù)字到模擬轉(zhuǎn)換器（DACs）將一個(gè)二進(jìn)制數(shù)轉(zhuǎn)換為與之對(duì)應(yīng)的電壓值，常用的D/A轉(zhuǎn)換器都是由電阻或電容加權(quán)網(wǎng)絡(luò)、受碼元控制的開關(guān)和基準(zhǔn)電壓或電流源組成。當(dāng)D/A轉(zhuǎn)換器需要轉(zhuǎn)換的信號(hào)每次取樣字長(zhǎng)很長(zhǎng)時(shí)，對(duì)這些電路的精度要求很高，并且還必須在整個(gè)溫度范圍和整個(gè)使用壽命期間內(nèi)保持電路參數(shù)的穩(wěn)定。例如，一個(gè)16位的D/A轉(zhuǎn)換器，其MSB的精度必須在1/2 16以內(nèi)，這是很困難的。所以，需尋求一種中保持高分辨率又可降低對(duì)電路精度和穩(wěn)定度要求的方法。

可綜合的Delta-Sigma DAC（術(shù)語Delta-Sigma分別指算術(shù)差與和，即Δ-∑DAC），是Xilinx公司提供的免費(fèi)IP核，可從網(wǎng)上下載得到。

4數(shù)字技術(shù)編輯

Delta-Sigma DAC使用數(shù)字技術(shù)，因而它不受溫度的影響，并且能在一片可編程邏輯器件中實(shí)現(xiàn)。避免在D/A轉(zhuǎn)換器中使用匹配電阻，不僅能更便宜，而且，其轉(zhuǎn)換是線性的。Delta-Sigma DAC實(shí)際上是高速單個(gè)位的DAC，用數(shù)字反饋技術(shù)，在輸出端產(chǎn)生一串脈沖。脈沖串中信號(hào)為高電平的時(shí)間部分與二進(jìn)制輸入成比例，當(dāng)這個(gè)脈沖串通過一個(gè)模擬低通濾波器后就得到一個(gè)模擬輸出信號(hào)。

圖1

是一個(gè)典型的可編程邏輯器件實(shí)現(xiàn)的DAC的頂層電路圖，輸入信號(hào)有復(fù)位信號(hào)、時(shí)鐘信號(hào)以及二進(jìn)制數(shù)據(jù)總線。輸出DACoutDrvr驅(qū)動(dòng)一個(gè)外部的低通濾波器Vout能從0V～Vcco。這里Vcco是FPGA I/O塊的供電電壓。輸入/輸出詳細(xì)說明如表1所列。

表1 輸入輸出描述表

信號(hào) 方向 描 述

DACOUT 輸出 驅(qū)動(dòng)外部低通濾波器的脈沖串（通過一個(gè)輸出驅(qū)動(dòng)器）

DACIN 輸入 數(shù)字輸入總線，值必須設(shè)置成鐘的正沿

clk 輸入 正沿有效

Reset 輸入 復(fù)位信號(hào)初始化SigmaLatch和輸出D觸發(fā)器

DAC的二進(jìn)制輸入是一個(gè)無符號(hào)數(shù)?！?”代表最低電壓，輸出的模擬電壓也只有正的?！?”輸入產(chǎn)生0V輸出，輸入端全“1”，則輸出近似達(dá)到Vcco。

圖2

是Delta-Sigma DAC的原理框圖，二進(jìn)制輸入的位寬是可變的。為簡(jiǎn)單起見，電路原理圖描述了一個(gè)8位二進(jìn)制輸入的DAC。

在這個(gè)器件中，二進(jìn)制加法器用來產(chǎn)生和，也用來產(chǎn)生差。盡管Delta Adder的輸入是無符號(hào)數(shù)，兩個(gè)加法器的輸出卻都是有符號(hào)數(shù)。Delta Adder計(jì)算DAC輸入和當(dāng)前DAC輸出的差，并用一個(gè)二進(jìn)制數(shù)表示。因?yàn)镈AC的輸出是一個(gè)單個(gè)的位，因此它不是1就是0。如圖2所示，當(dāng)輸入加上由Sigma Latch的輸出的兩個(gè)拷貝與0構(gòu)成的10位數(shù)，就產(chǎn)生差值，這也補(bǔ)償了DACIN是無符號(hào)數(shù)的事實(shí)。Sigma Adder將它原來的輸出（保存在Sigma Latch中）與當(dāng)前的Delta Adder的輸出相加。

圖1中輸出電壓與輸入電壓的關(guān)系為

VOUT=(DACIN/(2MSBI+1))×VCCO

式中單位為V。

例如，對(duì)于一個(gè)8位DAC（MSBI=7），最后的輸出是這樣：DACIN輸入是0，則輸出也是0；DACIN輸入是十六進(jìn)制數(shù)FF時(shí)，輸出值為最大(255/256)×Vcco。

阻容低通濾波器適合多數(shù)應(yīng)用需要，一個(gè)簡(jiǎn)單的阻容低通濾波器就能工作得很好。

Vs的定義是：DAC輸入增加或減少時(shí)，在Vout端產(chǎn)生變化的絕對(duì)值。對(duì)一個(gè)8位DAC，Vs等于（1/256）×Vcco。

Vout能夠產(chǎn)生在0V～Vcco之間可變的電壓，具體的值由DACIN的位寬和輸入的數(shù)值決定。

Delta-Sigma DAC適合需要相對(duì)高精度的低頻應(yīng)用。在這種應(yīng)用中，電壓不會(huì)很快地變化，因此，RC的時(shí)間常數(shù)可以很大，以減小噪聲。

這種DAC最廣泛的應(yīng)用就是產(chǎn)生通常直流電壓。這包括電壓控制振蕩器、電壓控制運(yùn)算放大器、I/O參數(shù)電壓、可編程電壓源、波形發(fā)生器（正弦、三角等）、A/D轉(zhuǎn)換中的參考電壓等。

Delta-Sigma DAC是一個(gè)例子，說明高速可編程邏輯器件能用于混合信號(hào)系統(tǒng)，以減少元件的數(shù)量?？删幊踢壿嬈骷乃俣群兔芏仁顾鼈兂蔀槟M信號(hào)產(chǎn)生和處理方面理想的元件。

5語言程序編輯

用VHDL語言編寫的程序

library ieee;

use ieeestd_logic_1164.all;

use ieee.std_logic_arith.all;

use ieee.std_logic_unsigned.all;

entity dac_ds is

port(reset :in std_logic;

clk :in std_logic;

din :in std_logic_vector(7 downto 0);--Signed integer

dout :out std_logic;

);

end dac_ds;

architecture arch_dac_ds of dac_ds is

signal error :std_logic_vector(9 downto 0);--Error accumulator is 2 bits larger

constant zeros:std_logic_vector(7 downto 0):=(others=>'0');

begin

process(reset,clk,din)

variable val :std_logic_vector(9 downto 0);

begin

if reset='1'then

error<=(others=>'0');

dout<='0';

elsif clk'event and clk='1' then

--val:=din+error;din is sign extended to nbits+2

val:=(din(din'high)&din(din'high)&din)+error;

if val(val'high)='0'then

dout<='1';

error<=val+("11"& zeros);

else

dout<='0';

error<=val+("01"&zeros);

end if;

end if;

end process;

end arch_dac_ds;

6選擇和配置編輯

選擇MAX7000S系列可編程邏輯器件，編譯后由MAX+PLUS II軟件自動(dòng)配置進(jìn)EMP7032SLC44芯片，將生成的目標(biāo)文件通過編程電纜對(duì)器件進(jìn)行編程。

將該IP核實(shí)現(xiàn)的D/A轉(zhuǎn)換器用于新型智能電阻爐溫度控制儀中，因?yàn)檎{(diào)節(jié)爐溫的信號(hào)不要求變化很快，因此DAC的輸入二進(jìn)制信號(hào)為緩變信號(hào)。對(duì)于這種低頻應(yīng)用，可以將RC時(shí)間常數(shù)取得較大，以減小噪聲。這樣，可綜合的VHDL語言Delta-Sigma DAC模塊配置進(jìn)EMP7032芯片后，達(dá)到了預(yù)期的效果。

7注意事項(xiàng)編輯

知識(shí)產(chǎn)權(quán)（IP）的再使用是設(shè)計(jì)組贏得迅速上市時(shí)間的主要策略，因?yàn)榱艚o設(shè)計(jì)者完成諸如蜂窩電話和Internet路由器等熱門IC設(shè)計(jì)的周期只有3個(gè)月。設(shè)計(jì)者還需面對(duì)這樣一個(gè)嚴(yán)酷的現(xiàn)實(shí)，即IC的復(fù)雜度以每年55%的速率遞增，而設(shè)計(jì)能力每年僅提高21%。

為系統(tǒng)設(shè)計(jì)者專門制作的再使用IP彌補(bǔ)了這方面的不足。再使用既為IP建立者，也為系統(tǒng)設(shè)計(jì)者提供一種共享最佳IP核和主導(dǎo)模塊的方法。系統(tǒng)設(shè)計(jì)者的主要任務(wù)是在規(guī)定的周期時(shí)間內(nèi)研發(fā)出復(fù)雜的設(shè)計(jì)。這只有采用新設(shè)計(jì)方法和完全不同的芯片設(shè)計(jì)理念才能完成。IP再使用已經(jīng)成為系統(tǒng)設(shè)計(jì)方法的關(guān)鍵所在。

標(biāo)準(zhǔn)選擇

標(biāo)準(zhǔn)是再使用的基礎(chǔ)。在設(shè)計(jì)一個(gè)系統(tǒng)時(shí)，可供工程人員考慮的工業(yè)標(biāo)準(zhǔn)很多，比如半導(dǎo)體再使用標(biāo)準(zhǔn)（SRS），它是對(duì)各種工業(yè)再使用創(chuàng)議標(biāo)準(zhǔn)的補(bǔ)充,提出這些創(chuàng)議標(biāo)準(zhǔn)的組織包括“虛插座接口聯(lián)盟VSIA”等。再使用標(biāo)準(zhǔn)為IP設(shè)計(jì)流程中的各階段提供規(guī)則、指南和接口方法。它是高效設(shè)計(jì)方法的一個(gè)里程碑,讓可再用IP快捷地、即插即用地集成到系統(tǒng)解決方案成為可能。

再使用標(biāo)準(zhǔn)通常涉及到許多方面，如系統(tǒng)級(jí)設(shè)計(jì)、結(jié)構(gòu)、實(shí)現(xiàn)、驗(yàn)證以及文件編制和可交付清單等與IP有關(guān)的事項(xiàng)。例如，結(jié)構(gòu)分類目錄解決片上或片外的接口。實(shí)現(xiàn)分類目錄通過HDL代碼標(biāo)準(zhǔn)、物理表示、單元庫以及模擬子單元集中解決如何建立IP的問題。功能驗(yàn)證及可測(cè)試設(shè)計(jì)（DFT）標(biāo)準(zhǔn)則包含在驗(yàn)證分類目錄中。

選擇

根據(jù)IP使用的劃分，IP建立者可按下列三種形式設(shè)計(jì)IP：可再用、可重定目標(biāo)以及可配置?？稍儆肐P是著眼于按各種再使用標(biāo)準(zhǔn)定義的格式和快速集成的要求而建立的，便于移植，更重要的是有效集成?？芍囟繕?biāo)IP是在充分高的抽象級(jí)上設(shè)計(jì)的,因而可以方便地在各種工藝與結(jié)構(gòu)之間轉(zhuǎn)移?？膳渲肐P是參數(shù)化后的可重定目標(biāo)IP，其優(yōu)點(diǎn)是可以對(duì)功能加以裁剪以符合特定的應(yīng)用。這些參數(shù)包括總線寬度、存儲(chǔ)器容量、使能或禁止功能塊。硬IP與軟IP的意圖不同，因而對(duì)IP的開發(fā)和在這之后的IP的集成采用不同的方法。

硬IP

硬IP對(duì)功率、體積和性能進(jìn)行了優(yōu)化，并映射至特定的工藝。具體實(shí)例包括已完成布局布線的網(wǎng)表，以特定工藝庫或全定制物理布圖，或兩者之組合。硬IP是特定工藝來實(shí)現(xiàn)的，通常用GDSII格式表示。硬IP可以再使用，且由于它已處于設(shè)計(jì)表示的最底層，因而最容易集成。硬IP已完全用目標(biāo)工藝實(shí)現(xiàn)是按十分接近于標(biāo)準(zhǔn)單元庫元件的形式交付的，故而允許設(shè)計(jì)者將IP快速地集成在衍生產(chǎn)品中。硬IP最大的優(yōu)點(diǎn)是確保性能，如速度、功耗等。然而難以轉(zhuǎn)移到新工藝或集成到新結(jié)構(gòu)中，是不可重配置的。

軟IP

軟IP是以綜合形式交付的，因而必須在目標(biāo)工藝中實(shí)現(xiàn),并由系統(tǒng)設(shè)計(jì)者驗(yàn)證。其優(yōu)點(diǎn)是源代碼的靈活性，它可重定目標(biāo)于多種制作工藝，在新功能級(jí)中重新配置。

由于設(shè)計(jì)以高層次表示，因而軟IP是可再用的，易于重定目標(biāo)和重配置,然而預(yù)測(cè)軟IP的時(shí)序、面積與功率諸方面的性能較困難。為了實(shí)現(xiàn)最高效率的再使用并減少集成時(shí)間，IP應(yīng)從軟件源代碼開始;而為了確保性能，復(fù)雜IP應(yīng)以硬IP的形式共享。

軟插接

軟插接是開發(fā)符合再使用標(biāo)準(zhǔn)IP的過程，它應(yīng)成為建立新IP設(shè)計(jì)流程的組成部分。過程需要有關(guān)IP深層的知識(shí)，因此只有IP建立者最熟知IP塊，有能力建立這些些概念，在時(shí)序分析時(shí)去除假通路，并最終確定結(jié)果的正確性。與DFT一樣，軟插接會(huì)修改現(xiàn)有的設(shè)計(jì)流程來適應(yīng)再使用設(shè)計(jì)和生成附加可交付項(xiàng),因此在設(shè)計(jì)流程中應(yīng)及早考慮再使用事項(xiàng)。

提供獲取

IP資源庫為IP建立者和系統(tǒng)設(shè)計(jì)者提供共享和使用IP的基礎(chǔ)設(shè)施。這個(gè)系統(tǒng)應(yīng)讓IP建立者和系統(tǒng)設(shè)計(jì)者共享硬和軟兩方面的可再用IP。資源庫提供多場(chǎng)所的全方位訪問,系統(tǒng)集成的全方位開發(fā)。它也是設(shè)計(jì)師搜索、選擇、將再使用塊集成到自己系統(tǒng)中的快捷而又簡(jiǎn)便的途徑。

資源庫基礎(chǔ)設(shè)施還應(yīng)開辟一個(gè)區(qū)域,讓系統(tǒng)開發(fā)者提供反饋、出錯(cuò)報(bào)告、錯(cuò)誤改正及資源庫中任何有關(guān)IP塊的注解。反饋信息塊建立者對(duì)錯(cuò)誤的修復(fù)與改進(jìn)說明一起是塊數(shù)據(jù)庫列表的一部分。

8技術(shù)認(rèn)證編輯

認(rèn)證

認(rèn)證能確定IP塊是否符合相關(guān)的再使用標(biāo)準(zhǔn)。它提供一把表征塊再使用質(zhì)量的尺度,應(yīng)在IP進(jìn)入資源庫前完成。由于IP建立者熟知IP，他應(yīng)測(cè)試塊概念間的一致性以及與工具、庫以及硬件平臺(tái)的兼容性。一個(gè)獨(dú)立的認(rèn)證小組通過對(duì)可交付性、再使用性以及出錯(cuò)歷史記錄的隨機(jī)抽樣,預(yù)測(cè)IP核的質(zhì)量和可靠性,定出IP的分類等級(jí)。這個(gè)等級(jí)讓設(shè)計(jì)者有一個(gè)總體概念，如IP符合標(biāo)準(zhǔn)的準(zhǔn)確性有多好，再使用需多大的軟插接工作量。

集成優(yōu)化

對(duì)IP核的再使用，建立者需軟插接IP、進(jìn)行認(rèn)證、將它存放在系統(tǒng)設(shè)計(jì)者能訪問的資源庫中。自動(dòng)化工具提供多種手段，加速軟插接和資源庫的操作，認(rèn)證和集成過程的部分自動(dòng)化。工具制造商力爭(zhēng)實(shí)現(xiàn)更多的自動(dòng)化。在理想情況下，全部IP塊可從資源庫中按需供給。

周期加速

設(shè)計(jì)者幾乎沒有能力在三個(gè)月設(shè)計(jì)周期內(nèi)開發(fā)出合乎規(guī)格的新產(chǎn)品。如果對(duì)每個(gè)產(chǎn)品族建立一個(gè)設(shè)計(jì)平臺(tái)，設(shè)計(jì)組就能充分發(fā)揮平臺(tái)的作用，開發(fā)出產(chǎn)品的衍生品種。一種有效的再使用方法應(yīng)讓可再使用IP的開發(fā)作為平臺(tái)的一部分，并將IP塊快速地集成到衍生品種。

基礎(chǔ)設(shè)施

一旦IP開始普遍使用，提供該IP的支持是必要的。建立者繼續(xù)擁有IP，因?yàn)橹С炙枰顚拥闹R(shí)。建立者負(fù)責(zé)IP的更新，將最新版本放置在資源庫中。IP由為系統(tǒng)設(shè)計(jì)者服務(wù)的認(rèn)證組重新認(rèn)證。此外,建立者還應(yīng)在系統(tǒng)設(shè)計(jì)者集成IP遇到困難時(shí)提供必需的支持。

這樣可以么？

二、福建 泉州 石獅 這個(gè)IP怎么設(shè)計(jì)

上面弄自動(dòng)獲取

-下面的 218.85.157.99備用：218.85.152.99

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三、泉州富發(fā)工藝廠地址在哪里

泉州富發(fā)工藝廠位于福建省泉州市晉江市洪山街道洪江路福晉工業(yè)園內(nèi)。

四、“ip射出底”中的ip是什么意思？是指一種化學(xué)材料，還是指什么？

IP中底是指中底材質(zhì)直接延伸到鞋面上，構(gòu)成鞋面的部分，指的是鞋子的結(jié)構(gòu)而不是成分。

以上就是關(guān)于泉州IP射出產(chǎn)品工藝相關(guān)問題的回答。希望能幫到你，如有更多相關(guān)問題，您也可以聯(lián)系我們的客服進(jìn)行咨詢，客服也會(huì)為您講解更多精彩的知識(shí)和內(nèi)容。

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